AT91SAM7X128-AU integrou a microplaqueta do circuito integrado dos componentes

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Descrição do produto
AT91SAM7X512 AT91SAM7X256 AT91SAM7X128

Características
• Incorpora o processador de ARM7TDMI® ARM® Thumb®
– Arquitetura de 32 bits de capacidade elevada do RISC
– Grupo de instrução de 16 bits do alto densidade

• Líder em MIPS/Watt
– A emulation no circuito de EmbeddedICE™, elimina erros do apoio do canal de comunicação

• Flash de alta velocidade interno
– 512 Kbytes (AT91SAM7X512) organizaram em dois bancos de 1024 páginas de 256 bytes (o plano duplo)
– 256 Kbytes (AT91SAM7X256) organizaram em 1024 páginas de 256 bytes (o único plano)
– 128 Kbytes (AT91SAM7X128) organizaram em 512 páginas de 256 bytes (o único plano)

• Único acesso do ciclo em até 30 megahertz em condições do pior caso
• A execução de aperfeiçoamento da instrução do polegar do amortecedor do Prefetch apressa-se no máximo
• Tempo de programação da página: a Senhora 6, incluindo a página Auto-apaga, apaga completamente o tempo: Senhora 15

• 10.000 escreva ciclos, capacidade da retenção de 10 dados do ano, capacidades do fechamento do setor, bocado instantâneo da segurança
• Relação de programação instantânea rápida para a produção do volume alto

• SRAM de alta velocidade interno, velocidade do acesso do Único-ciclo no máximo
– 128 Kbytes (AT91SAM7X512)
– 64 Kbytes (AT91SAM7X256)
– 32 Kbytes (AT91SAM7X128)

• Controlador da memória (MC)
– Controlador instantâneo encaixado, estado do aborto e detecção do desalinhamento

• Controlador da restauração (RSTC)
– Baseado sobre Poder-em pilhas e na baixa potência restauradas Fábrica-calibrou o detector da baixa de pressão
– Fornece dar forma de sinal restaurado externo e o estado da fonte da restauração

• Gerador de pulso de disparo (CKGR)
– Oscilador da baixa potência RC, oscilador da Em-microplaqueta de 3 a 20 megahertz e um PLL

• Controlador da gestão do poder (PMC)
– Capacidades da otimização do poder, incluindo o modo de pulso de disparo lento (para baixo a 500 hertz) e o modo inativo
– Quatro sinais de pulso de disparo externos programáveis

• Controlador de interrupção avançado (AIC)
– Individualmente Maskable, prioridade do Oito-nível, fontes da interrupção Vectored
– Duas fontes da interrupção externo e uma fonte rápida da interrupção, interrupção especulativo protegeram

• Elimine erros da unidade (DBGU)
– 2 fio UART e apoio para a interrupção de canal de uma comunicação Debug,
Prevenção programável do acesso do GELO

• Temporizador de intervalo periódico (POÇO)
– contador programável de 20 bocados mais o contador mordido 12 do intervalo

• Cão de guarda de Windowed (WDT)
– o bocado 12 chave-protegeu o contador programável
– Fornece sinais da restauração ou da interrupção ao sistema
– Contra pode ser parado quando o processador for elimina erros dentro do estado ou no modo inativo

• Temporizador do tempo real (RTT)
– contador decorrida de 32 bits com alarme
– Foge o oscilador interno de RC

• Dois controladores de entrada/saída paralelos (PIO)
– Sessenta e duas linhas programáveis do I/O multiplexadas com os até dois I/Os periféricos
– Capacidade entrada da interrupção da mudança em cada linha do I/O
– O Aberto-dreno individualmente programável, levanta o resistor e a saída síncrono

• Treze canais periféricos do controlador de acesso direto da memória (PDC)
• Um porto do dispositivo da velocidade máxima de USB 2,0 (12 por segundo de Mbits)
– transceptor da Em-microplaqueta, 1352 byte FIFOs integrado configurável

• Uma base-T do MAC 10/100 dos ethernet
– Relação independente dos meios (MII) ou relação independente reduzida dos meios (RMII)
– 28 byte integrado FIFOs e canais de acesso direto da memória dedicados para Transmit e Receive

• 2.0A de uma parte e a parte 2.0B complacentes PODEM controlador
– Oito caixas postais Completo-programáveis do objeto da mensagem, contador de 16 bits do marcador temporal

• Um controlador de série síncrono (SSC)
– Pulso de disparo independente e sinais de sincronização do quadro para cada receptor e transmissor
– Mim apoio da relação análoga do ² S, apoio multiplex da divisão de tempo
– Capacidades de alta velocidade do córrego de dados contínuos com transferência de dados de 32 bits

• Dois transmissores síncronos/assíncronos universais do receptor (USART)
– Baud Rate Generator individual, modulação de IrDA®/demodulação infravermelhas
– Apoio para ISO7816 T0/T1 Smart Card, aperto de mão do hardware, apoio RS485
– Linha de modem completa apoio em USART1

• Dois mestres/escravo Serial Peripheral Interfaces (SPI)
– 8 - ao comprimento de dados programável de 16 bits, quatro Chip Selects periférico externo

• Uns temporizador do Três-canal/contador de 16 bits (TC)
– Três entradas de pulso de disparo externos, dois pinos de múltiplos propósitos do I/O pelo canal
– Geração dobro de PWM, captação/modo da forma de onda, capacidade Up/Down

• Um controlador de 16 bits da modulação da largura do poder do Quatro-canal (PWMC)
• Uma relação do Dois-fio (TWI)
– Apoio mestre do modo somente, todo o Dois-fio Atmel EEPROMs e os dispositivos compatíveis de I2 C apoiaram

• Um 8 conversor analógico-numérico do bocado do canal 10, quatro canais multiplexou com Digitas I/Os
• Auxílio da bota de SAM-BA™
– Programa da bota do defeito
– Relação com interface de usuário gráfica dos SAM-vagabundos

• Varredura do limite de IEEE® 1149,1 JTAG em todos os pinos de Digitas
• 5V-tolerant I/Os, incluindo quatro linhas Alto-atuais do I/O da movimentação, até 16 miliampères cada

• Fontes de alimentação
– Regulador 1.8V encaixado, elaborando a 100 miliampères para o núcleo e os componentes externos
– o I/O de 3.3V VDDIO alinha a fonte de alimentação, fonte de alimentação instantânea independente de 3.3V VDDFLASH
– fonte de alimentação do núcleo de 1.8V VDDCORE com detector da baixa de pressão

• Operação inteiramente estática: Até 55 megahertz em condições do pior caso 1.65V e 85°C
• Disponível 100 no verde da ligação LQFP e nos 100 pacotes do verde da bola TFBGA

Diagrama de bloco AT91SAM7X512/256/128