Família de Chip The max II do circuito integrado de EPM1270F256C5N de imediato-em, CPLDs permanente

A família do max II de imediato-em, CPLDs permanente é

baseado em uns 0,18 m

Introdução

A família de MAX® II de imediato-em, CPLDs permanente é baseada em um processo de 0.18-µm, 6 camada-metal-flashes, com densidades de 240 a 2.210 elementos de lógica macrocells equivalentes (de LEs) (128 a 2.210) e a um armazenamento permanente de 8 Kbits. Os dispositivos do max II oferecem contagens altas do I/O, o desempenho rápido, e o encaixe seguro contra outras arquiteturas de CPLD. Caracterizando o núcleo de MultiVolt, um bloco da memória Flash do usuário (UFM), e o programmability aumentado do em-sistema (ISP), dispositivos do max II são projetados reduzir o custo e o poder ao fornecer soluções programáveis para aplicações tais como a construção de uma ponte sobre do ônibus, a expansão do I/O, poder-na restauração (POR) e arranjando em sequência o controle, e o controle de configuração do dispositivo.

Características

O max II CPLD tem as seguintes características:

■Barato, baixa potência CPLD

■Imediato-em, arquitetura permanente

■Corrente à espera tão baixa como o µA 25

■Fornece tempos rápidos do atraso e da pulso de disparo-à-saída de propagação

■Fornece quatro pulsos de disparo globais os dois pulsos de disparo disponíveis pelo bloco da disposição de lógica (o LABORATÓRIO)

■Bloco até 8 Kbits de UFM para o armazenamento permanente

■Núcleo de MultiVolt permitindo tensões de fonte externo ao dispositivo de um ou outro 3,3 V de V/2.5 V ou 1,8

■Relação do I/O de MultiVolt que apoia níveis da lógica 3.3-V, 2.5-V, 1.8-V, e 1.5-V

■a arquitetura Ônibus-amigável que incluem a taxa de pântano programável, a força da movimentação, a ônibus-posse, e programáveis levantam os resistores

■Schmitt provoca a possibilidade das entradas tolerantes do ruído (programáveis pelo pino)

■I/Os são inteiramente complacentes com a especificação especial componente periférica do ônibus local do PCI do grupo de interesse da interconexão (SIG do PCI), revisão 2,2 para a operação 3.3-V em 66 megahertz

■Apoios quentes-socketing

■Circuitos comum incorporados do teste da limite-varredura do grupo de ação do teste (JTAG) (BST) complacentes com padrão 1149.1-1990 de IEEE

■Circuitos do ISP complacentes com padrão 1532 de IEEE

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