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Características
• Regulador complacente do NÚCLEO de IMVP-IV™
• Conversão de poder monofásica
• Detecção atual “sem perda” para a eficiência melhorada e a área reduzida da placa
- Resistor discreto opcional do sentido da corrente de precisão
• Movimentação da porta e diodo internos da tira de bota
• Tensão Regulatin do NÚCLEO da precisão
- 0,8% temperaturas excessivas da precisão de sistema
• entrada da identificação da tensão do microprocessador 6-Bit
• “Inclinação programável” e de tensão do NÚCLEO taxa de pântano a cumprir com a especificação de IMVP-IV™
• Modo descontínuo de operação para a eficiência de carga clara aumentada no modo de sono profundo e mais profundo
• Relação direta com lógica de sistema
(STP_CPU e DPRSLPVR) para o modo de sono profundo e mais profundo de operação
• Tensão facilmente programável Setpoints para a “bota inicial”, o sono profundo e os modos de sono mais profundo
Descrição
ISL6218 o controle monofásico IC do fanfarrão PWM, com o meio motorista integrado da porta da ponte, fornece um sistema do regulamento de tensão da precisão para os microprocessadores avançados do Pentium-m nos laptop. Este controle IC igualmente caracteriza ambo o controle atual do reação da tensão de entrada e o médio do modo para a resposta dinâmica excelente, MOSFET de utilização de detecção atual “sem perda” RDS (SOBRE), e frequências de comutação selecionáveis do usuário de 250kHz a 500kHz pela fase
O ISL6218 inclui um conversor numérico-analógico de 6 bocados (DAC) que ajuste dinamicamente a tensão da saída do NÚCLEO PWM de 0.700V a 1.708V nas etapas 16mV, e conforma-se à especificação móvel de Intel IMVP-IV™ VID. O ISL6218 igualmente tem as entradas da lógica para selecionar o modo de sono ativo, profundo e de sono mais profundo de operação. Uma referência da precisão, uma detecção remota e uma arquitetura proprietária com “inclinação compensada processador-modo integrada” fornecem o regulamento de tensão estático e dinâmico excelente do NÚCLEO.
Uma outra característica do controlador de ISL6218 IC é o circuito de atraso interno de PGOOD que guarda o ponto baixo do pino de PGOOD para 3ms a 12ms após o VCCP e reguladores de VCC_MCH estão dentro do regulamento. Este sinal de PGOOD é mascarado durante mudanças de VID. A sobretensão e o undervoltage da saída são monitorados e resultado no conversor que trava fora e sinal de PGOOD que está sendo guardado baixo.
Informação pedindo
NÚMERO DA PEÇA | MARCAÇÃO DA PARTE | Temperatura. ESCALA (°C) | PACOTE | DWG # |
ISL6218CV* | ISL 6218CV | -10 a +85 | 38 Ld TSSOP | M38.173 |
ISL6218CVZ* (nota) | ISL 6218CVZ | -10 a +85 |
38 Ld TSSOP (Pb-livre) |
M38.173 |
ISL6218CVZA* (nota) | ISL 6218CVZ | -10 a +85 |
38 Ld TSSOP (Pb-livre) |
M38.173 |
ISL6218CRZ* (nota) | ISL62 18CRZ | -10 a +85 | 40 Ld 6x6 QFN (Pb-livres) | L40.6x6 |
Avaliações máximas absolutas
Tensão de fonte VDD, VDDP…………………. -0,3 a +7V
Tensão da bateria, VBAT…………………………. +25V
Boot1 e UGATE1……………………………. +33V
Phase1 e ISEN1……………………………. +28V
Boot1 no que diz respeito a Phase1……………………. +6.5V
UGATE1. ………………. (Phase1 - 0.3V) a (Boot1 + 0.3V)
Todos pinos restantes……………………. -0.3V a (VDD + 0.3V)
Condições operacionais recomendadas
Tensão de fonte, VDD, VDDP…………………. +5V ±5%
Tensão da bateria, VBAT……………………. +5.6V a 21V
Temperatura ambiental. …………………. - 10°C a +85°C
Temperatura de junção…………………. - 10°C a +125°C