Grupo de ChongMing (HK) Co. internacional, Ltd

CHONGMING GROUP (HK) INT'L CO., LTD.

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A placa de circuito do silicone lasca o transceptor da camada física dos ethernet de DP83848CVVX/NOPB

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Cidade:shenzhen
País / Região:china
Pessoa de contato:MsDoris Guo
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A placa de circuito do silicone lasca o transceptor da camada física dos ethernet de DP83848CVVX/NOPB

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Number modelo :DP83848C
Lugar de origem :Malásia
Quantidade de ordem mínima :5pcs
Termos do pagamento :T/T, Western Union, Paypal
Capacidade da fonte :1000PCS
Prazo de entrega :1 dia
Detalhes de empacotamento :Contacte-me por favor para detalhes
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A placa de circuito do silicone lasca o transceptor da camada física dos ethernet de DP83848C

De transceptor portuário da camada física dos ethernet da temperatura comercial único 10/100 Mb/s de DP83848C PHYTER

A descrição que geral O DP83848C é um robusto caracterizou inteiramente 10/100 de consumo de oferecimento da baixa potência do único dispositivo portuário da camada física, incluir diverso poder inteligente abaixo dos estados. Estes modos da baixa potência aumentam a confiança de produto total devido à dissipação de poder diminuída. Que apoia o poder modos inteligentes múltiplos permite que a aplicação use a quantidade de poder mínima absoluta necessária para a operação. O DP83848C inclui um pulso de disparo 25MHz para fora. Isto significa que a aplicação pode ser projetada com um mínimo de peças externos, que conduza por sua vez ao mais baixo custo total possível da solução. O DP83848C conecta facilmente aos meios do twisted pair através de um transformador externo. MII e RMII são apoiados assegurando a facilidade e a flexibilidade do projeto. O DP83848C caracteriza sublayers integrados para apoiar protocolos dos ethernet o 10BaseT e 100BASE-TX, que se assegura de que a compatibilidade e a interoperabilidade com todos padrões restantes baseiem soluções dos ethernet. O DP83848C é oferecido em um fatora de formulários pequeno (48 pino LQFP) de modo que um mínimo de espaço da placa seja necessário.

Características

• Baixa potência 3.3V, tecnologia de 0.18µm CMOS

• Consumo da baixa potência < 270mW="" Typical="">

• 3.3V MAC Interface

• Auto-MDIX para 10/100 de Mb/s

• Modo da detecção da energia

• Pulso de disparo de 25 megahertz para fora

• Relação de SNI (configurável)

• Rev. 1,2 relação de RMII (configurável)

• MII relação de série da gestão (CDM e MDIO)

• IEEE 802.3u MII

• Auto-negociação de IEEE 802.3u e detecção paralela

• IEEE transceptores ENDEC, 10BaseT de 802.3u e filtros

• IEEE transceptores PCS, 100BASE-TX de 802.3u e filtros

• O sublayer físico complacente integrado do ANSI X3.263 TP-PMD com igualação adaptável e a linha de base vagueiam compensação

• Operação sem erros até 137 medidores

• O modo programável da relação de apoio do diodo emissor de luz 10 do /100 Mb/s, a atividade, e a colisão detectam

• Único acesso do registro para o estado completo de PHY

• 10/100 de pacote BIST de Mb/s (construído em de auto-teste)

• 48 pacote do pino LQFP (7mm) x (7mm)

Conexões especiais

Nome do sinal Tipo Pin # Descrição
RBIAS Mim 24 Conexão do resistor diagonal. 4,87 um resistor do kΩ 1% deve ser conectado de RBIAS à terra.
PFBOUT O 23 Saída do feedback do poder. Os tampões paralelos, 10µ F (tântalo preferido) e 0.1µF, devem ser colocados perto do PFBOUT. Conecte este pino a PFBIN1 (pino 18) e a PFBIN2 (pino 37). Veja a seção 5,4 para o pino apropriado da colocação.
PFBIN1 PFBIN2 Mim

18

37

O feedback do poder entrou. Estes pinos são alimentados com poder do pino de PFBOUT. Um capacitor pequeno de 0.1µF deve ser conectado perto de cada pino. Nota: Não forneça o poder a estes pinos diferentes de PFBOUT.
RESERVADO I/O 8,9,10,11,12 RESERVADO: Estes pinos devem ser deixados desligados.
RESERVADO I/O 20,21 RESERVADO: Estes pinos devem ser levantados através de 2,2 resistores do kΩ à fonte AVDD33.

Pinos da fonte de alimentação

Nome do sinal PIN# Descrição
IOVDD33 32,48 Fonte do I/O 3.3V
IOGND 35,47 O I/O moeu
DGND 36 Terra de Digitas
AVDD33 22 Fonte 3.3V análoga
AGND 15,19 Terra análoga

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