Payment Terms :T/T, Western Union, Paypal, segurança de comércio, cartão de crédito
Capacidade da fonte :80 PCes
Prazo de entrega :3-5 dia
Detalhes de empacotamento :Empacotamento do standard internacional
Categoria :IC FPGA
Circunstância :Original 100%, brandnew e original, novo
Número de blocos da disposição de lógica - laboratórios :14144
Número de I/Os :I/O 920
Pacote/caso :FBGA-1932
Taxa de dados :600 Mb/s a 8,5 Gb/s
Série :Stratix IV GX
Frequência de funcionamento máxima :600 megahertz
Serviço :BOM Kitting
Prazo de execução :Em conservado em estoque, contato nós
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I/O Stratix IV GX da microplaqueta FBGA-1932 920 de EP4SGX360NF45I4N ALTERA FPGA
Atributo de produto
Valor de atributo
Intel
FPGA - Disposição de porta programável do campo
Stratix IV GX
353600
14144
I/O 920
900 milivolt
- 40 C
+ 85 C
SMD/SMT
FBGA-1932
Bandeja
Taxa de dados:
600 Mb/s a 8,5 Gb/s
Série:
Stratix IV GX
Tipo:
Intel/Altera
Frequência de funcionamento máxima:
600 megahertz
Umidade sensível:
Sim
Número de transceptores:
Transceptor 48
Tipo de produto:
FPGA - Disposição de porta programável do campo
Quantidade do bloco da fábrica:
12
Subcategoria:
Lógica programável CI
Memória total:
kbit 22564
Tradename:
Stratix
Parte # pseudônimos:
974496
Os dispositivos de Stratix IV GX fornecem até 48 canais CDR-baseados completo-frente e verso do transceptor pelo dispositivo:
■Trinta e dois dos 48 canais do transceptor dedicaram o sublayer de codificação físico (PCS) e circuitos e apoio médios físicos do acessório (PMA) taxas de dados entre 600 Mbps e 8,5 Gbps ■Os 16 canais permanecendo do transceptor dedicaram taxas de dados dos circuitos e do apoio de PMA-only entre 600 Mbps e Gbp 6,5 ■Stratix IV GX-PCIe Gen1 e Gen2, GbE, RapidIO de série, SONET/SDH, XAUI/HiGig, (OIF) CEI-6G, SD/HD/3G-SDI, canal da fibra, SFI-5, GPON, SAS/SATA, HyperTransport 1,0 e 3,0, e Interlaken ■Aplicações do complexo e do valor-limite da raiz ■configurações da pista x1, x4, e x8 ■Relação complacente da TUBULAÇÃO 2,0 ■Circuitos encaixados a comutar entre taxas de dados Gen1 e Gen2 ■Circuitos incorporados para a geração e detecção inativa elétrica, receptor para detectar, transições do estado do poder, reversão da pista, e inversão da polaridade ■Codificador 8B/10B e decodificador, máquina de estado da sincronização do receptor, e ± 300 porções por milhão circuitos da compensação do pulso de disparo (ppm) ■Apoio da camada da transação para até dois canais virtuais (VCs) ■Apoio de XAUI/HiGig ■Complacente à especificação de IEEE802.3ae ■Circuitos encaixados da máquina de estado para converter grupos de código inativos de XGMII (||Mim||) a e dos grupos pedidos inativos (||||, ||K||, ||R||) no transmissor e receptor, respectivamente ■Codificador 8B/10B e decodificador, máquina de estado da sincronização do receptor, deskew da pista, e circuitos da compensação do pulso de disparo do ± 100 ppm
