Vista geral integrada XC6SL4-2TQG144C da família da microplaqueta Spartan-6 de IC do contador programado

Vista geral integrada XC6SL4-2TQG144C da família da microplaqueta Spartan-6 de IC do contador programado

Família da microplaqueta Spartan-6 de XC6SL4-2TQG144C Xilinx Parogramm IC

Características

• Família Spartan-6:

• Spartan-6 LX FPGA: Lógica aperfeiçoada

• Spartan-6 LXT FPGA: Conectividade de série de alta velocidade

• Projetado para o baixo custo

• Blocos integrados eficientes múltiplos

• Seleço aperfeiçoada de padrões do I/O

• Almofadas desconcertadas

• Pacotes fio-ligados plásticos do volume alto

• Poder baixo estático e dinmico

• processo de 45 nanômetro aperfeiçoado para o custo e a baixa potência

• Hibernar o modo do poder-para baixo para o poder zero

• Suspenda o modo mantem o estado e a configuraço com o multi-pino de alerta, controla o realce

• tenso do núcleo do Baixo-poder 1.0V (LX FPGAs, -1L somente)

• Tenso do núcleo do elevado desempenho 1.2V (categorias da velocidade de LX e de LXT FPGAs, -2, -3, e -4)

• Multi-tenso, bancos multi-padro da relaço de SelectIO™

• Taxa de transferência de até 1.050 dados de Mb/s pelo I/O do diferencial

• Movimentaço selecionável da saída, até 24 miliampères pelo pino

• 3.3V aos padrões e aos protocolos do I/O 1.2V

• Relações da memória barata de HSTL e de SSTL

• Conformidade quente da troca

• Taxas de pntano ajustáveis do I/O para melhorar a integridade de sinal

• Transceptores de série de alta velocidade de GTP no LXT FPGAs

• Até 3,125 Gb/s

• Relações de alta velocidade

Descriço geral

A família Spartan®-6 fornece capacidades principais da integraço de sistemas o mais baixo custo total para aplicações do volume alto. A família do treze-membro entrega as densidades expandidas que variam de 3.840 a 147.443 pilhas da lógica, com metade do consumo de potência de famílias espartanos precedentes, e uma conectividade mais rápida, mais detalhada. Construído em uma tecnologia de processamento madura do cobre da baixa potência de 45 nanômetro que entregasse o equilíbrio óptimo do custo, do poder, e do desempenho, as ofertas da família Spartan-6 um novo, mais eficiente, o duplo-registro 6 entraram a lógica da tabela de consulta (LUT) e uma seleço rica do sistema-nível incorporado obstrui. Estes incluem 18 ram do bloco do Kb (2 x Kb 9), fatias da segunda geraço DSP48A1, controladores da memória de SDRAM, blocos aumentados da gesto do pulso de disparo do misturado-modo, tecnologia de SelectIO™, blocos de série de alta velocidade poweroptimized do transceptor, blocos compatíveis do valor-limite do PCI Express®, modos avançados da gesto do poder do sistema-nível, auto-detectam opções de configuraço, e a segurança aumentada do IP com proteço de AES e de ADN do dispositivo. Estas características fornecem uma alternativa programável barata aos produtos feitos sob encomenda de ASIC a acessibilidade inaudita. A oferta de Spartan-6 FPGAs a melhor soluço para projetos da lógica do volume alto, DSP consumidor-orientado projeta, e aplicações encaixadas custo-sensíveis. Spartan-6 FPGAs so a fundaço programável do silicone para as plataformas visadas do projeto que entregam os componentes integrados do software e de hardware que permitem desenhistas de se centrar sobre a inovaço assim que seu ciclo de desenvolvimento começar. Sumário de Spartan-6 FPGA

incluir: Serial ATA, Aurora, Ethernet 1G, PCI Express, OBSAI, CPRI, EPON, GPON, DisplayPort, e XAUI • O bloco integrado do valor-limite para PCI Express projeta (LXT) • Apoio de tecnologia barato de PCI® compatível com os 33 megahertz, 32 - e especificaço 64-bit. • Fatias DSP48A1 eficientes • Tratamento dos sinais de capacidade elevada da aritmética e • Jejua o acumulador de 18 x 18 multiplicadores e de 48 bocados • Capacidade de canalizaço e de conexo em cascata • Pre-adicionador para ajudar a aplicações do filtro • Blocos integrados do controlador da memória • Apoio da RDA, do DDR2, do DDR3, e do LPDDR • Taxas de dados até 800 Mb/s (largura de faixa do pico de 12,8 Gb/s) • a estrutura do ônibus do Multi-porto com o FIFO independente para reduzir o sincronismo do projeto emite • Recursos abundantes da lógica com capacidade aumentada da lógica • Registro de deslocamento opcional ou apoio distribuído de RAM • 6 eficientes LUTs entrado melhora o desempenho e minimiza o poder • LUT com flip-flops duplos para aplicações céntricas do encanamento • Bloco RAM com uma vasta gama de granulosidade • O bloco rápido RAM com byte escreve permite • 18 blocos do Kb que podem opcionalmente ser programados como o independente dois 9 ram do bloco do Kb • Telha (CMT) da gesto do pulso de disparo para o desempenho aumentado • Cronometrar de baixo nível de ruído, flexível • Os gerentes de pulso de disparo (DCMs) de Digitas eliminam a distorço do ciclo do enviesamento e de dever do pulso de disparo • Laços Fase-Fechados (PLLs) para cronometrar do baixo-tremor • Síntese da freqência com multiplicaço, diviso, e o deslocador simultneos • Dezesseis redes globais do pulso de disparo do baixo-enviesamento • Configuraço simplificada, padrões baratos dos apoios • o pino 2 auto-detecta a configuraço • SPI da terceira largo (até x4) e NEM apoio instantneo • Flash rico da plataforma de Xilinx da característica com JTAG • Apoio de MultiBoot para a elevaço remota com bitstreams múltiplos, usando a proteço do co de guarda • Segurança aumentada para a proteço do projeto • Identificador original do ADN do dispositivo para a autenticaço do projeto • Cifragem do bitstream de AES nos dispositivos maiores • Processamento mais rapidamente encaixado com custo aumentado, baixo, processador macio de MicroBlaze™ • Projetos líder de mercado do IP e da referência

Sumário da característica de Spartan-6 FPGA

Tabela 1: Sumário da característica de Spartan-6 FPGA pelo dispositivo

Notas: 1. As avaliações da pilha da lógica de Spartan-6 FPGA refletem a capacidade aumentada da pilha da lógica oferecida pela arquitetura entrada nova de 6 LUT.

2. Cada fatia de Spartan-6 FPGA contem quatro LUTs e oito flip-flops.

3. Cada fatia DSP48A1 contem um multiplicador 18 x 18, um adicionador, e um acumulador.

4. As ram do bloco so o Kb fundamental 18 em tamanho. Cada bloco pode igualmente ser usado como o independente dois 9 blocos do Kb.

5. Cada CMT contem dois DCMs e um PLL.

Combinações do Dispositivo-Pacote de Spartan-6 FPGA e I/Os disponível

Tabela 2: Combinações do Dispositivo-Pacote Spartan-6 e máximo I/Os disponível

Notas:

1. No há nenhum controlador da memória nos dispositivos nestes pacotes.

2. O apoio do bloco do controlador da memória é x8 nos dispositivos XC6SLX9 e XC6SLX16 no pacote CSG225. No há nenhum controlador da memória no XC6SLX4.

3. Estes dispositivos so disponíveis no Pb e Pb-livres (G) pacotes adicionais como opções pedindo padro.

4. Estes pacotes apoiam dois dos quatro controladores da memória nos dispositivos de XC6SLX75, de XC6SLX75T, de XC6SLX100, de XC6SLX100T, de XC6SLX150, e de XC6SLX150T.

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