Microplaqueta MCU de 16 bits do circuito integrado ST10F269-Q3 COM MEMÓRIA FLASH da UNIDADE, do BYTE 256K E 12K o BYTE do MAC RAM

ST10F269

MCU de 16 bits COM MEMÓRIA FLASH da UNIDADE, do BYTE 256K E 12K o BYTE do MAC RAM

Processador central do ELEVADO DESEMPENHO 40MHz do ■ COM FUNÇO de DSP

  – processador central de 16 bits COM O ENCANAMENTO 4-STAGE

  – TEMPO de CICLO da INSTRUÇO 50ns No PULSO DE DISPARO do PROCESSADOR CENTRAL de 40MHz MAX

  – UNIDADE de MULTIPLY/ACCUMULATE (MAC) MULTIPLICAÇO de 16 bits de 16 x, ACUMULADOR 40-BIT

  – UNIDADE DE REPETIÇO

  – FACILIDADES BOOLEANAS AUMENTADAS DA MANIPULAÇO DE BOCADO

  – INSTRUÇÕES ADICIONAIS PARA APOIAR HLL E SISTEMAS OPERACIONAIS

  – APOIO DO INTERRUPTOR DE CONTEXTO DE SINGLE-CYCLE

ORGANIZAÇO DA MEMÓRIA DO ■

  – 256K TENSO da MEMÓRIA FLASH do BYTE ON-CHIP ÚNICA COM CONTROLADOR de ERASE/PROGRAM.

  – CICLOS de 100K ERASING/PROGRAMMING.

  – O ESPAÇO PARA ENDEREÇO LINEAR do BYTE de ATÉ 16M PARA o CÓDIGO E os DADOS (BYTES de 5M COM LATA)

  – 2K BYTE ON-CHIP RAM INTERNO (IRAM)

  – 10K EXTENSO RAM do BYTE ON-CHIP (XRAM)

ÔNIBUS RÁPIDO E FLEXÍVEL DO ■

  – CARACTERÍSTICAS EXTERNOS PROGRAMÁVEIS DO ÔNIBUS PARA ESCALAS DE ENDEREÇO DIFERENTES

  – ÔNIBUS de DADOS EXTERNOS de 8 bits OU de 16 bits

  – ÔNIBUS EXTERNOS MULTIPLEXADOS OU DEMULTIPLEXED DE ADDRESS/DATA

  – CINCO SINAIS MICROPLAQUETA-SELETOS PROGRAMÁVEIS

  – APOIO DO ARBÍTRIO DO ÔNIBUS DE HOLD-ACKNOWLEDGE

INTERRUPÇO do ■

  – CONTROLADOR do EVENTO PERIFÉRICO do 8-CANAL PARA ÚNICA DADOS CONDUZIDOS do CICLO INTERRUPÇO

     TRANSFERÊNCIA

  – SISTEMA de INTERRUPÇO 16-PRIORITY-LEVEL COM 56 FONTES, TAXA de AMOSTRA PARA BAIXO A 25ns

TEMPORIZADORES do ■

  – DUAS UNIDADES DE USO GERAL MULTI-FUNCIONAIS DO TEMPORIZADOR COM 5 TEMPORIZADORES

a CAPTAÇO 16-CHANNEL do ■ DOIS/COMPARA UNIDADES

CONVERSOR DO A/D DO ■

  – 16-CHANNEL 10-BIT

  – TEMPO da CONVERSO 4.85µs No PULSO DE DISPARO do PROCESSADOR CENTRAL 40MHz

UNIDADE do ■ 4-CHANNEL PWM

CANAIS DA SÉRIE DO ■

  – CANAL DE SÉRIE SÍNCRONO/ASSÍNCRONO

  – CANAL SÍNCRONO DE ALTA VELOCIDADE

O ■ DOIS PODE AS RELAÇÕES 2.0B que OPERAM-SE EM UM OU DOIS PODE ÔNIBUS

  (30 OU OBJETOS da MENSAGEM 2x15)

PROTEÇO DA SEGURANÇA CONTRA FALHAS DO ■

  – TEMPORIZADOR DE CO DE GUARDA PROGRAMÁVEL

  – CO DE GUARDA DO OSCILADOR

CARREGADOR DE TIRA DE BOTA DO ■ ON-CHIP

GERAÇO DE PULSO DE DISPARO DO ■

  – ON-CHIP PLL

  – DIRIJA OU ENTRADA DE PULSO DE DISPARO DE PRESCALED

PULSO DE DISPARO DE TEMPO REAL DO ■

■ ATÉ 111 LINHAS DE USO GERAL DO I/O

  – INDIVIDUALMENTE PROGRAMÁVEL COMO A ENTRADA, A SAÍDA OU A FUNÇO ESPECIAL

  – PONTO INICIAL PROGRAMÁVEL (HISTERESE)

MODOS DA QUIETUDE E DO PODER DO ■ PARA BAIXO

FONTE DA TENSO DO ■ ÚNICA: 5V ±10% (REGULADOR ENCAIXADO PARA a FONTE do NÚCLEO de 3,3 V).

VARIAÇO DA TEMPERATURA DO ■: -40 +125° C

PACOTE do ■ 144-PIN PQFP

Avaliações máximas absolutas

Nota: 1. os esforços acima daqueles alistados sob “avaliações máximas absolutas” podem causar dano permanente ao dispositivo. Este é um esforço que avalia somente e a operaço funcional do dispositivo nestes ou de nenhuma outra condições acima daqueles indicados nas seções operacionais desta especificaço no é implicada. A exposiço s condições da avaliaço máxima absoluta por períodos prolongados pode afetar a confiança do dispositivo. Durante as condições de sobrecarga (V_EM >_DDde V ou V< V=""> _NOS SS) a tenso nos pinos no que diz respeito terra (V_SS) no deve exceder os valores definidos pelas avaliações máximas absolutas.

Símbolo de lógica

Configuraço de Pin (vista superior)

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