Série 16Kbit, 8Kbit, 4Kbit, 2Kbit e 1Kbit de M24C08-WMN6TP mim ônibus EEPROM do ² C

Série 16Kbit, 8Kbit, 4Kbit, 2Kbit e 1Kbit de M24C08-WMN6TP mim ônibus EEPROM do ² C

CARACTERÍSTICAS SUMÁRIAS

Dois a relaço de série do fio I2C apoia o protocolo 400kHz

Única tenso de fonte: – 4,5 a 5.5V para M24Cxx – 2,5 a 5.5V para M24Cxx-W – 1,8 a 5.5V para M24Cxx-R escrevem a entrada de controle

O BYTE e a PÁGINA ESCREVEM (até 16 bytes)

 Modos LIDOS ALEATÓRIOS e SEQUENCIAIS

Ciclo de programaço Auto-programado

Incremento de endereço automático

Comportamento aumentado de ESD/Latch-Up

Mais de 1 milho Erase/escrevem ciclos

Retenço de mais de 40 dados do ano

DESCRIÇO SUMÁRIA

Estes dispositivos programáveis apagáveis da memória de I2C-compatible (EEPROM) so organizados eletricamente como 2048/1024/512/256/128 x 8 (M24C16, M24C08, M24C04, M24C02, M24C01).

2C usa uma relaço de série de dois fios, compreendendo uma linha de dados bidirecional e uma linha do pulso de disparo. Os dispositivos levam um tipo de dispositivo código do bocado do acessório 4 do identificador (1010) de acordo com a definiço do ônibus de I2C. O dispositivo comporta-se como um escravo no protocolo de I2C, com todas as operações de memória sincronizadas pelo pulso de disparo de série. Leia e escreva operações so iniciados por uma condiço do começo, gerada pelo mestre do ônibus. A condiço do começo é seguida por um código seleto do dispositivo e pelo bocado do RW (como descrito na tabela 2.), terminados por um bocado do reconhecimento.

Ao redigir dados memória, o dispositivo introduz um reconhecimento mordido durante a 9a vez do bocado, seguindo a transmisso de 8 bits do mestre do ônibus. Quando os dados so lidos pelo mestre do ônibus, o mestre do ônibus reconhece o recibo do byte de dados da mesma forma. Transferências de dados so terminadas por uma condiço de parada após um Ack para Write, e após um NoAck para lido.

Poder na restauraço: VCC o fechamento escreve - proteja

A fim impedir a corrupço de dados e inadvertido escreva operações durante a ligaço inicial, um poder no circuito de (POR) da restauraço é incluído. Na ligaço inicial, a restauraço interna está guardada ativa até que VCC alcancem o valor de ponto inicial de POR, e todas as operações esto desabilitadas – o dispositivo no responderá a nenhum comando. Da mesma forma, quando as gotas VCC da tenso de funcionamento, abaixo do valor de ponto inicial de POR, todas as operações so desabilitadas e o dispositivo no responderá a nenhum comando. Um VCC estável e válido (como definido na tabela 6. e na tabela 7.) devem ser aplicado antes de aplicar qualquer sinal da lógica.

DESCRIÇO DO SINAL

Pulso de disparo de série (SCL). Este sinal de entrada é usado ao estroboscópio todos os dados dentro e fora do dispositivo. Nas aplicações onde este sinal é usado por dispositivos do escravo sincronizar o ônibus a um pulso de disparo mais lento, o mestre do ônibus deve ter uma saída aberta do dreno, e um resistor levantar pode ser conectado do pulso de disparo de série (SCL) a VCC. (Figura 4. indica como o valor do resistor levantar pode ser calculado). Na maioria de aplicações, embora, este método da sincronizaço no é empregado, e assim que no resistor levantar no é necessário, contanto que o mestre do ônibus tem um push pull (um pouco do que o dreno aberto) output.

Dados de série (SDA). Este sinal bidirecional é usado transferir dados ou fora do dispositivo. É um dreno aberto output que possa ser fio-OR'ed com o outro dreno aberto ou abrir sinais do coletor no ônibus. Um resistor levantar deve ser conectado dos dados de série (SDA) a VCC. (Figura 4. indica como o valor do resistor levantar pode ser calculado).

A microplaqueta permite (E0, E1, E2). Estes sinais de entrada so usados ajustar o valor que deve ser procurada nos três bocados o mais menos significativos (b3, b2, b1) dos 7 - código seleto do dispositivo do bocado. Estas entradas devem ser amarradas a VCC ou a VSS, para estabelecer o código seleto do dispositivo.

Escreva o controle (WC). Este sinal de entrada é útil para proteger os índices inteiros da memória de inadvertido escreve operações. Escreva operações esto desabilitados disposiço inteira da memória quando escreva o controle (WC) é conduzido altamente. Quando desligado, o sinal é lido internamente como VIL, e escrito operações é reservado. Quando escreva o controle (WC) é conduzido altamente, dispositivo seleto e os bytes do endereço esto reconhecidos, bytes de dados no esto reconhecidos.

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