DS1232LP+ Componentes de circuito integrado do chip MicroMonitor de baixa potência

Chip micromonitor DS1232LP+ de baixa potência

CARACTERÍSTICAS

Verso de super baixo consumo de energia do DS1232

50 A corrente quiescente

Pára e reinicia um microprocessador fora de controle

Reinicia automaticamente o microprocessador após falha de energia

Monitora o boto para substituiço externa

Monitoramento preciso da fonte de alimentaço do microprocessador de 5% ou 10% DIP de 8 pinos, SOIC de 8 pinos ou pacote µ-SOP para economia de espaço disponível

Pacote SOIC opcional de 16 pinos disponível

Temperatura industrial –40°C a +85°C disponível, designado N

DESCRIÇO

O chip DS1232LP/LPS Low Power MicroMonitor monitora três condições vitais para um microprocessador: fonte de alimentaço, execuço de software e substituiço externa.Primeiro, um circuito comparador e de referência com compensaço de temperatura de preciso monitora o status do VCC.Quando ocorre uma condiço fora da tolerncia, um sinal interno de falha de energia é gerado, o que força a redefiniço para o estado ativo.Quando o VCC retorna a uma condiço de tolerncia, os sinais de reinicializaço so mantidos no estado ativo por no mínimo 250 ms para permitir que a fonte de alimentaço e o processador se estabilizem.

A segunda funço que o DS1232LP/LPS executa é o controle de reinicializaço por boto.O DS1232LP/LPS debounce a entrada do boto e garante uma largura de pulso de reinicializaço ativa de no mínimo 250 ms.A terceira funço é um temporizador de vigilncia.O DS1232LP/LPS tem um temporizador interno que força os sinais de reset para o estado ativo se a entrada do estroboscópio no for reduzida antes do tempo limite.A funço do temporizador de vigilncia pode ser configurada para operar em configurações de tempo limite de aproximadamente 150 ms, 600 ms e 1,2 segundos.

OPERAÇO - MONITOR DE ENERGIA

O DS1232LP/LPS detecta condições de fornecimento de energia fora da tolerncia e avisa um sistema baseado em processador de falha de energia iminente.Quando VCC cai abaixo de um nível predefinido conforme definido por TOL, o comparador VCC emite os sinais RST e RST.Quando o TOL está conectado ao terra, os sinais RST e RST tornam-se ativos conforme o VCC cai abaixo de 4,75 volts.Quando o TOL está conectado ao VCC, os sinais RST e RST tornam-se ativos conforme o VCC cai abaixo de 4,5 volts.O RST e o RST so excelentes sinais de controle para um microprocessador, pois o processamento é interrompido nos últimos momentos possíveis de VCC válido.Ao ligar, RST e RST so mantidos ativos por no mínimo 250 ms para permitir que a fonte de alimentaço e o processador se estabilizem.OPERAÇO – RESET DE BOTO O DS1232LP/LPS fornece um pino de entrada para conexo direta a um boto de presso (Figura 1).A entrada de reset do boto requer um sinal baixo ativo.Internamente, esta entrada é debounced e cronometrada de forma que os sinais RST e RST de pelo menos 250 ms sejam gerados.O atraso de 250 ms começa quando a entrada de reset do boto é liberada do nível baixo.

OPERAÇO - TEMPORIZADOR DE GUARDA

A funço do temporizador watchdog força os sinais RST e RST para o estado ativo quando a entrada ST no é estimulada por um período de tempo predeterminado.O período de tempo é definido pela entrada TD para ser tipicamente 150 ms com TD conectado ao terra, 600 ms com TD deixado desconectado e 1,2 segundos com TD conectado ao VCC.O cronômetro de vigilncia começa a expirar a partir do período de tempo definido assim que RST e RST estiverem inativos.Se ocorrer uma transiço de alto para baixo no pino de entrada ST antes do tempo limite, o temporizador watchdog é redefinido e começa a expirar novamente.Se o timer do watchdog tiver permisso para expirar, os sinais RST e RST sero direcionados para o estado ativo por no mínimo 250 ms.A entrada ST pode ser derivada de sinais de endereço do microprocessador, sinais de dados e/ou sinais de controle.Quando o microprocessador estiver funcionando normalmente, esses sinais, como uma questo de rotina, faro com que o watchdog seja reinicializado antes do tempo limite.Para garantir que o timer do watchdog no atinja o tempo limite, uma transiço de alto para baixo deve ocorrer no mínimo ou abaixo do mínimo mostrado na Tabela 1. Um exemplo de circuito típico é mostrado na Figura 2.

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