Tri núcleo de 32 bits 200MHz PG-LFBGA-292-6 INSTANTÂNEO de 4MB 4M x 8 de Chip Ic do microcontrolador da C.C. AURIX de SAK-TC277TP-64F200N

FLASH de 32 bits PG-LFBGA-292-6 do Tri núcleo 200MHz 4MB de IC do microcontrolador de SAK-TC277TP-64F200N TriCore™ AURIX™ (4M x 8)

Folha de dados: SAK-TC277TP-64F200N

Sumário das características

A família de produto de TC27x tem as seguintes características:

• Microcontrolador do elevado desempenho com três núcleos do processador central

• Dois processadores centrais super-escalares de 32 bits de TriCore (TC1.6P), cada um que tem as seguintes características:

– Desempenho superior do tempo real

– Manipulaço mordida forte

– Capacidades inteiramente integradas de DSP

– Multiplicar-acumule a unidade capaz de sustentar 2 operações do MAC pelo ciclo

– Unidade inteiramente canalizada da vírgula flutuante (FPU)

– uma operaço de até 200 megahertz na variaço da temperatura completa

– borrador RAM de até 120 dados do Kbyte (DSPR)

– borrador RAM de uma instruço de até 32 Kbyte (PSPR)

– Esconderijo de uma instruço de 16 Kbyte (ICACHE)

– Esconderijo de 8 dados do Kbyte (DCACHE)

• Processador central escalar eficiente de TriCore do poder (TC1.6E), tendo as seguintes características:

– Compatibilidade do código binário com TC1.6P

– uma operaço de até 200 megahertz na variaço da temperatura completa

– borrador RAM de até 112 dados do Kbyte (DSPR)

– até 24 borradores RAM da instruço do Kbyte (PSPR)

– Esconderijo de uma instruço de 8 Kbyte (ICACHE)

– amortecedor lido de dados 0.125Kbyte (DRB)

• Núcleos da sombra de Lockstepped para um TC1.6P e para TC1.6E

• Memórias múltiplas da em-microplaqueta

– Toda a MNV e SRAM encaixados so CCE protegida

– memória Flash de um programa de até 4 Mbyte (PFLASH)

– memória Flash de até 384 dados do Kbyte (DFLASH) útil para a emulation de EEPROM

– Uma memória de 32 Kbyte (LMU)

– BootROM (BROM)

• controlador de acesso direto da memória 64-Channel com transferência de dados segura

• Sistema de interrupço sofisticado (a CCE protegeu)

• Estrutura do ônibus da em-microplaqueta do elevado desempenho

– interconexo 64-bit da barra transversal (SRI) que dá rapidamente o acesso paralelo entre mestres do ônibus, processadores centrais e memórias

– ônibus periférico do sistema de 32 bits (SPB) para unidades periféricas e funcionais da em-microplaqueta

– Uma ponte do ônibus (ponte de SFI)

• Módulo opcional da segurança do hardware (HSM) em algumas variações

• Unidade de gesto da segurança (SMU) que segura alarmes do monitor da segurança

• Unidade do teste da memória com CCE, iniciaço da memória e funções de MBIST (MTU)

• Monitor do I/O do hardware (IOM) para verificar do I/O digital

• Unidades periféricas da Em-microplaqueta versátil

– Quatro assíncronos/canais de série síncronos (ASCLIN) com apoio de LIN do hardware (V1.3, V2.0, V2.1 e J2602) até 50 MBaud

– Quatro canais de relaço enfileirados de SPI (QSPI) com capacidade do mestre e do escravo até 50 Mbit/s

– Relaço de série de alta velocidade (HSSL) para uma comunicaço de série do inter-processador até 320 Mbit/s

– Duas relações de ônibus do micro de série segundas (CAM) para a expanso da porta de série aos dispositivos de alimentaço externa

– Um módulo de MultiCAN+ com 4 nós da LATA e 256 objetos assinalávéis livres da mensagem para eficiência elevada de manipulaço de dados através da proteço do FIFO e da transferência de dados da entrada

– 10 únicos canais da transmisso da mordidela da borda (ENVIADA) para a conexo aos sensores

– Um módulo de FlexRayTM com 2 canais (E-Ray) V2.1 de apoio

– Um módulo genérico do temporizador (GTM) que fornece um grupo poderoso de filtraço digital do sinal e de funcionalidade do temporizador para realizar a gesto autônoma e complexa do entrada/saída

– Uma captaço/compara o módulo 6 (dois núcleos CCU60 e CCU61)

– Uma unidade do temporizador do uso geral 12 (GPT120)

– Relaço periférica do sensor de três canais que conforma-se a V1.3 (PSI5)

– Relaço periférica do sensor com PHY de série (PSI5-S)

– Relaço de ônibus Inter-integrada opcional do circuito (I2C) que conforma-se a V2.1

– MAC opcional dos ethernet IEEE802.3 com RMII e MII relações (ETH)

• Aproximaço sucessiva versátil CAD (VADC)

– Conjunto de 8 núcleos independentes do CAD

– Escala de tenso entrada de 0 V a 5.5V (fonte do CAD)

• Delta-Sigma CAD (DSADC) – seis canais

• Portos programáveis do I/O de Digitas

• a Em-microplaqueta elimina erros do apoio para o nível 1 de OCDS (processadores centrais, o acesso direto da memória, em Chip Buses)

• eliminaço de erros do multi-núcleo, traçado do tempo real, e calibraço

• quatro/relaço de cinco fios de JTAG (IEEE 1149,1) ou de DAP (porta de acesso do dispositivo)

• Reguladores do sistema de gesto e da em-microplaqueta do poder

• Unidade da geraço de pulso de disparo com sistema PLL e Flexray PLL

• Regulador de tenso encaixado

Imagem dos dados:

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