I/O 1240kbit Xilinx Virtex 5 de XC5VFX100T-2FF1738C 680
Payment Terms:T/T, Western Union, Paypal, segurança de comércio, cartão de crédito
Number modelo:XC5VFX100T-2FF1738C
Quantidade de ordem mínima:1 PCS
Capacidade da fonte:186 PCes
Prazo de entrega:3-5 dia
Detalhes de empacotamento:Empacotamento do standard internacional
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Shenzhen Guangdong China
Endereço:
R1811, B Bldg, torre de Jiahe, No.3006 Shennan Rd meados de, Shenzhen, China
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No 27 Horas
Detalhes do produto
Perfil da empresa
Detalhes do produto
I/O 550 megahertz Virtex-5 de XC5VFX100T-2FF1738C IC FPGA FBGA-1738 680
| Atributo de produto | Valor de atributo |
|---|---|
| Xilinx | |
| FPGA - Disposiço de porta programável do campo | |
| Virtex-5 | |
| I/O 680 | |
| 1 V | |
| 0 C | |
| + 85 C | |
| SMD/SMT | |
| FCBGA-1738 | |
| Taxa de dados: | 6,5 Gb/s |
| Série: | XC5VFX100T |
| Tipo: | Xilinx |
| RAM distribuído: | kbit 1240 |
| Bloco encaixado RAM - EBR: | kbit 8208 |
| Frequência de funcionamento máxima: | 550 megahertz |
| Umidade sensível: | Sim |
| Número de transceptores: | Transceptor 16 |
| Tipo de produto: | FPGA - Disposiço de porta programável do campo |
| Quantidade do bloco da fábrica: | 1 |
| Subcategoria: | Lógica programável CI |
| Tradename: | Virtex |
Sumário de características de Virtex-5 FPGA
• Transceptores de RocketIO GTP 100 Mb/s a 3,75 Gb/s
− LXT e plataformas de SXT
• Transceptores de RocketIO GTX 150 Mb/s a 6,5 Gb/s
− TXT e plataformas de FXT
• PowerPC 440 microprocessadores
Plataforma do − FXT somente
Arquitetura do RISC do −
encanamento da fase do − 7
os esconderijos da instruço e dos dados do − 32-Kbyte incluíram
Estrutura aperfeiçoada − da relaço do processador (barra transversal)
• tecnologia de processamento do CMOS do cobre de 65 nanômetro
• tenso do núcleo 1.0V
• Empacotamento alto da aleta-microplaqueta da sinal-integridade disponível em opções padro ou Pb-livres do pacote
• Capacidade da monitoraço de sistema em todos os dispositivos
Em-microplaqueta do −/monitoraço térmica da Fora-microplaqueta
monitoraço da fonte da Em-microplaqueta do −/alimentaço da Fora-microplaqueta
Acesso do − JTAG a todas as quantidades monitoradas
• Blocos integrados do valor-limite para projetos de PCI Express
Plataformas do − LXT, do SXT, do TXT, e do FXT
− complacente com a especificaço baixa 1,1 de PCI Express
apoio da pista x1, x4, ou x8 do − pelo bloco
Trabalhos do − conjuntamente com transceptores de RocketIO™
Os geradores de funço so configuráveis como 6 a entrada LUTs ou entrada LUTs da duplo-saída 5. SLICEMs em algum CLBs pode ser
configurado para operar-se como registros de deslocamento de 32 bits (ou x de 16 bits 2 registros de deslocamento) ou como RAM distribuído 64-bit. Além,
quatro elementos de armazenamento podem ser configurados como travas sensíveis borda-provocadas do D-tipo flip-flops ou do nível.
Cada CLB tem a interconexo rápida interna e conecta- uma matriz de interruptor para alcançar recursos de distribuiço gerais.
− LXT e plataformas de SXT
• Transceptores de RocketIO GTX 150 Mb/s a 6,5 Gb/s
− TXT e plataformas de FXT
• PowerPC 440 microprocessadores
Plataforma do − FXT somente
Arquitetura do RISC do −
encanamento da fase do − 7
os esconderijos da instruço e dos dados do − 32-Kbyte incluíram
Estrutura aperfeiçoada − da relaço do processador (barra transversal)
• tecnologia de processamento do CMOS do cobre de 65 nanômetro
• tenso do núcleo 1.0V
• Empacotamento alto da aleta-microplaqueta da sinal-integridade disponível em opções padro ou Pb-livres do pacote
• Capacidade da monitoraço de sistema em todos os dispositivos
Em-microplaqueta do −/monitoraço térmica da Fora-microplaqueta
monitoraço da fonte da Em-microplaqueta do −/alimentaço da Fora-microplaqueta
Acesso do − JTAG a todas as quantidades monitoradas
• Blocos integrados do valor-limite para projetos de PCI Express
Plataformas do − LXT, do SXT, do TXT, e do FXT
− complacente com a especificaço baixa 1,1 de PCI Express
apoio da pista x1, x4, ou x8 do − pelo bloco
Trabalhos do − conjuntamente com transceptores de RocketIO™
Os geradores de funço so configuráveis como 6 a entrada LUTs ou entrada LUTs da duplo-saída 5. SLICEMs em algum CLBs pode ser
configurado para operar-se como registros de deslocamento de 32 bits (ou x de 16 bits 2 registros de deslocamento) ou como RAM distribuído 64-bit. Além,
quatro elementos de armazenamento podem ser configurados como travas sensíveis borda-provocadas do D-tipo flip-flops ou do nível.
Cada CLB tem a interconexo rápida interna e conecta- uma matriz de interruptor para alcançar recursos de distribuiço gerais.
I/O 1240kbit Xilinx Virtex 5 de XC5VFX100T-2FF1738C 680
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